多速率适配方法及pcie设备
技术领域
1.本发明涉及通信技术领域，尤其涉及一种多速率适配方法及pcie设备。
背景技术：2.pcie接口最早用于pc上的扩展插槽接口，用于高速接口的设备之间传输数据，5g时代的到来，为了更好的满足网络对大数据传输的需求，5g通信模块需要用到pcie接口做数据传输。pcie接口硬件特性也决定了其枚举适配所需要的特定条件，pcie接口是一种端对端的连接拓扑模式，所以首先要有一个对端pcie设备；其次两个对端设备需要有属于自己的接口工作模式，一个设备作为pcie主机端(root complex)，另外一个设备作为pcie设备端(endpoint)；最后两个对端设备的枚举需要进行信息的交互，配置的同步。
3.pcie分析仪是一种专业抓取pcie物理总线信号的仪器，这种仪器可以实时抓取pcie主机端(root complex)以及设备端的(endpoint)的交互信息，是一种有效的调试，定位分析的辅助工具，这种仪器必须要有严格的pcie物理总线的速度匹配关系，速度不匹配是无法抓取到正确的，有效的调试信息。目前不同速度等级的pcie分析仪基础硬件主体不能完全兼容，升级更高速度等级的pcie分析仪需要更换新的硬件设备；且购买以及升级更高速度等级的pcie分析仪成本高，从提交申请升级速度等级到更新软体、硬体设备需要的周期长，不能解决急需问题；因为pcie root complex在主机端的bios配置都是固定的，不允许修改，且随意升级bios的pcie总线速度配置风险大，所以常规的pcie root complex主机端都是配置为automatic；每次调试不同pcie总线速度等级的m.2设备，繁琐且耗时长，且每一次调试的总线信号衰减补偿并不能全部兼容不同pcie总线速度等级的pcie分析仪应用，极大的增加的人力工时的成本，效率低。
技术实现要素：4.基于此，本技术提供一种多速率适配方法及pcie设备，以克服上述技术缺陷。
5.第一方面，本技术提供一种多速率适配方法，包括：
6.获取pcie主机端的速度等级与pcie设备端的速度等级；若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同；根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。
7.结合第一方面，在一个可行的实施例中，若pcie主机端的速度等级高于或者等于pcie设备端的速度等级，则根据pcie设备端的速度等级通过pcie总线与pcie主机端进行数据通信。
8.结合第一方面，若pcie主机端的速度等级小于pcie设备端的速度等级，则根据pcie主机端的速度等级适配pcie设备端的速度等级包括：根据pcie主机端速度等级降低pcie设备端的速度等级，以使pcie设备端的速度等级与pcie主机端速度等级相同。
9.结合第一方面，根据pcie主机端速度等级适配pcie设备端的速度等级，还包括：
10.根据pcie主机端速度等级触发pcie总线物理链路re-train，以使pcie设备端与pcie主机端正常通信。
11.结合第一方面，在一个可行的实施例中，根据pcie主机端速度等级触发pcie总线物理链路re-train包括：
12.调训pcie总线物理链路的速度等级；
13.调训pcie总线物理链路的链路带宽；
14.调训pcie总线物理链路的信号质量值。
15.结合第一方面，根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信：
16.根据pcie主机端的速度等级，匹配对应速度等级的阻抗匹配参数、信号衰减补偿参数；
17.选择与阻抗匹配、信号衰减补偿的参数对应的通信线路后通过pcie总线与pcie主机端进行数据通信。
18.结合第一方面，在一个可行的实施例中，获取pcie主机端的速度等级与pcie设备端的速度等级之前，该方法还包括：pcie设备端进行硬件初始化，配置时钟信号，配置ddr类型。
19.第二方面，本技术实施例提供一种pcie设备，包括：
20.获取模块：用于获取pcie主机端的速度等级与pcie设备端的速度等级；
21.调整模块：用于若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同；
22.通信模块：用于根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。
23.第三方面，本技术实施例提供一种计算机设备，包括存储器和处理器，所述存储器存储有计算机程序，所述处理器执行所述计算机程序时实现第一方面所述的方法的部分或全部。
24.第四方面，本技术实施例提供一种计算机可读存储介质，其上存储有计算机程序，其特征在于，所述计算机程序被计算机设备执行时实现第一方面所述的方法的部分或全部。
25.pcie分析仪需要与pcie物理总线的速度严格匹配，获取pcie设备端和pcie主机端的速度等级，在pcie设备端和pcie主机端的速度等级不匹配时，通过调整pcie设备端的速度等级来适配pcie设备端和pcie主机端之间的速度等级，以解决当pcie设备端和pcie主机端的速度等级不匹配时，pcie模块适应当前只有较低速度等级的pcie分析仪，节省了设备仪器购买成本和人力工时调试阻抗匹配的成本。
附图说明
26.为了更清楚地说明本发明实施例中的技术方案，下面将对实施例中所需要使用的附图作简单地介绍。
27.图1为本技术实施例提供的pcie模块的结构示意图；
28.图2为本技术实施例提供的一种多速率适配方法的流程示意图；
29.图3为本技术实施例提供的一种多速度等级通信线路的结构示意图；
30.图4为本技术实施例提供的另一种pcie设备的结构示意图；
31.图5为本技术实施例提供的另一种pcie设备的结构示意图。
具体实施方式
32.本技术以下实施例中所使用的术语只是为了描述特定实施例的目的，而并非旨在作为对本技术的限制。如在本技术的说明书和所附权利要求书中所使用的那样，单数表达形式“一个”、“一种”、“所述”、“上述”、“该”和“这一”旨在也包括复数表达形式，除非其上下文中明确地有相反指示。
33.在本技术中，“至少一个(项)”是指一个或者多个，“多个”是指两个或两个以上，“至少两个(项)”是指两个或三个及三个以上，“和/或”，用于描述关联对象的关联关系，表示可以存在三种关系，例如，“a和/或b”可以表示：只存在a，只存在b以及同时存在a和b三种情况，其中a，b可以是单数或者复数。字符“/”一般表示前后关联对象是一种“或”的关系。“以下至少一项(个)”或其类似表达，是指这些项中的任意组合。例如，a，b或c中的至少一项(个)，可以表示：a，b，c，“a和b”，“a和c”，“b和c”，或“a和b和c”。
34.下面结合附图对本技术作进一步详细描述。
35.参见图1，图1为本技术实施例提供的pcie模块的结构示意图。如图1所示，该pcie模块包括pcie设备端101，pcie控制器1011，pcie主机端102，pcie分析仪1021；
36.其中pcie设备端(pcie endpoint，pe)101作为pcie总线操作的发起者处于pcie总线拓扑结构的最末端，主要包括固态硬盘(solid state disk，ssd)，只读存储器(read-only memory，rom)，图形处理器(graphics processing unit,gpu)等设备；
37.pcie控制器1011用于获取pcie主机端和pcie设备端的速度等级在pcie主机端和pcie设备端的速度等级不匹配时，调整pcie设备端速度等级以适配pcie主机端的速度等级；
38.pcie主机端102可以看成一个根复合体(root complex，rc)，rc为cpu和pcle总线之间的接口，可以包含几个组件(处理器接口、dram接口等)，甚至可以包含几个芯片。rc位于pci倒立树拓扑的“根”，并代表cpu与系统的其余部分进行通信。
39.pcie分析仪1021用于实时抓取pcie主机端和pcie设备端的交互信息，是一种有效的调试，定位分析的辅助工具。
40.参见图2，图2为本技术实施例提供的一种多速率适配方法的流程示意图。如图2所示，该方法包括：
41.s201、获取pcie主机端的速度等级与pcie设备端的速度等级。
42.具体地，pcie接口是一种端对端的的链接拓扑模式，pcie接口需要一个对端的pcie设备，即pcie主机端和pcie设备端，若pcie主机端接受数据的速度等级无法与pcie设备端传输数据的速度等级匹配，将导致pcie模块无法正常工作，pcie分析仪也无法抓取比自身速度等级高的pcie总线数据，因此获取pcie主机端的速度等级与pcie设备端用于对比pcie主机端与pcie设备端的速度等级是否匹配，是否需要调整适配。
43.在一种可能的实施例中，若pcie主机端的速度等级高于或者等于pcie设备端的速
度等级，则根据pcie设备端的速度等级通过pcie总线与pcie主机端进行数据通信。
44.具体地，当pcie主机端的速度等级高于或者等于pcie设备端，pcie总线则可以正常传输数据，pcie分析仪可以抓取pcie总线数据。
45.s202、若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同。
46.具体地，只有当pcie设备端的速度等级大于pcie主机端的设备等级时才需要调整pcie设备端的速度等级来适配pcie主机端的速度等级，以使pcie总线正常传输数据，pcie分析仪可以抓取pcie总线数据。
47.在一个示例中，最大gen1速度等级的pcie分析仪只能抓取gen1速度等级的pcie总线数据，不能抓取gen2,gen3,gen4速度等级的pcie总线数据；
48.在一个示例中，最大gen2速度等级的pcie分析仪只能抓取gen1、gen2速度等级的pcie总线数据，不能抓取gen3,gen4速度等级的pcie总线数据；
49.在一个示例中，最大gen3速度等级的pcie分析仪只能抓取gen1、gen2、gen3速度等级的pcie总线数据，不能抓取gen4速度等级的pcie总线数据。
50.在一种可能的实施例中，若pcie主机端的速度等级小于所述pcie设备端的速度等级，则根据所述pcie主机端的速度等级适配pcie设备端的速度等级包括：根据所述pcie主机端速度等级降低所述pcie设备端的速度等级，以使所述pcie设备端的速度等级与所述pcie主机端速度等级相同。
51.具体地，由于pcie主机端和pcie设备端的数据通信需要在同一速度等级下才能正常通信，因此当pcie主机端的速度等级小于pcie设备端的速度等级时，需要将pcie设备端的速度等级限制为pcie主机端的速度等级，即降低pcie设备端的速度等级，以使pcie设备端的速度等级为pcie主机端的速度等级，进而保证pcie主机端和pcie设备端的正常通信。
52.在一种可能的实施例中，根据pcie主机端速度等级适配pcie设备端的速度等级，还包括：根据pcie主机端速度等级触发pcie总线物理链路re-train，以使pcie设备端与pcie主机端正常通信。
53.具体地，pcie主机端速度等级与pcie设备端的速度等级同步后，pcie物理链路的总线速度等级可能还处于pcie设备端调整前的速度等级状态，此时根据pcie主机端速度等级触发pcie总线物理链路re-train，重新调训物理链路后pcie主机端和pcie设备端才能正常通信。
54.在一种可能的实施例中，根据pcie主机端速度等级触发pcie总线物理链路re-train包括：调训pcie总线物理链路的速度等级；调训pcie总线物理链路的链路带宽；调训pcie总线物理链路的信号质量值。
55.具体地，pcie控制器限制pcie设备端的速度等级后，还需要对pcie总线物理链路进行重新调训以适应新的数据传输速度等级，包括调训所述pcie总线物理链路的速度等级，例如当pcie总线物理链路需要从gen1调整为gen2时，需要进行速度等级调训bit lock和symbol lock等参数都需要重新获取，pcie总线的的接收端链路上没有时钟，symbol lock表示pcie链路上获取开始训练的标记符com字符的过程，bit lock表示通过接收到发送端发过来的报文信息(带有时钟信息)来获取时钟信息的过程；调训所述pcie总线物理链路的链路带宽,带宽是指在固定的时间可传输的资料数量，亦即在传输管道中可以传递数
据的能力，当pcie总线物理链路的速度等级改变是，需要重新调训物理链路的链路带宽；调训所述pcie总线物理链路的信号质量值，信号质量值指在pcie总线物理上传输的强弱、传输速率等参数的调训。
56.在一种可能的实施例中，根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信：根据pcie主机端的速度等级，匹配对应速度等级的阻抗匹配参数、信号衰减补偿参数；选择与阻抗匹配、信号衰减补偿的参数对应的通信线路后通过pcie总线与pcie主机端进行数据通信。
57.具体地，请参见图3，图3为本技术实施例提供的一种多速度等级通信线路的结构示意图，不同速度等级的pcie主机端和pcie设备端的数据传输对应不同的阻抗匹配参数、信号衰减补偿参数，而不同的阻抗匹配参数、信号衰减补偿参数需要对应的电子元件实现，在pcie装置端中分别预置不同速度等级的阻抗匹配参数、信号衰减补偿参数对应的传输线路，根据适配后的pcie设备端的速度等级，选取对应的阻抗匹配参数、信号衰减补偿参数对应的传输线路进行数据传输。
58.s203、根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。
59.具体地，通过pcie控制器将pcie设备端的速度等级限制，并根据新的速度等级重新调训pcie总线物理链路后，pcie设备端和pcie主机端通过新的速度等级进行数据传输，pcie分析仪根据其自带的许可(license)，对pcie总线数据进行抓取，这里的pcie分析仪license与速度等级有对应关系，gen1的速度等级的pcie分析仪license只能抓取速度等级为gen1的总线数据，因此当pcie设备端的速度等级高于pcie分析仪license许可的速度等级时，pcie分析仪将无法正常抓取pcie总线上的数据。在pcie设备端的速度等级与调整后，pcie主机端就可以与pcie设备端通过pcie总线进行数据通信，pcie分析仪则根据自身的license抓取pcie总线上的数据。
60.在一种可能的实施例中，获取pcie主机端的速度等级与pcie设备端的速度等级之前，方法还包括：pcie设备端进行基本硬件初始化，配置时钟信号，配置ddr类型。
61.具体地在开始获取pcie主机端和pcie设备端的速度等级前，pcie模块需要进行一系列初始化操作，包括基本硬件的启动初始化；配置时钟信号pcie总线物理链路间的数据传送使用基于时钟的同步传送机制，但是在物理链路上并没有时钟线，pcie总线的接收端含有时钟数据恢复cdr(clock data recovery)模块，cdr模块将从接收报文中提取接收时钟，从而进行同步数据传递；配置双倍速率(double data rate，ddr)类型，通过ddr技术可以使数据传输速度为系统时钟频率的两倍，不同类型的ddr在带宽速度、工作频率等方面有区别，因此需要在获取pcie主机端和pcie设备端的速度等级前确定pcie模块的ddr类型。
62.在一种可能的实施例中，应用于pcie设备端的多速率适配方法，可以在任意一种支持pcie协议的接口上实现。
63.具体地，本实施例的多速率适配方法，是基于pcie模块实现的，可以在任意一种支持pcie协议的接口上实现，例如m.2接口，pcie接口，mpcie接口等。
64.可以看出，本技术实施例通过获取pcie主机端的速度等级与pcie设备端的速度等级；若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同；根据pcie主机端的速
度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。使不同速度等级的pcie设备端和pcie主机端的速度等级都可以正常通信，保证pcie分析仪可以抓取与其自身速度等级不匹配的pcie设备和pcie主机端之间的pcie总线数据，可以减去对pcie分析仪的license以及总线物理信号阻抗匹配的强依赖性，可以适应当前只有较低速度等级的pcie分析仪的场景，提高了pcie主机端的pcie分析仪的兼容性，不需要从主机端的bios去调整pcie总线速度，达到提供优于竞品模块的适配性，节省了设备仪器购买成本和人力工时调试阻抗匹配的成本。
65.参见图4，图4为本技术实施例提供的一种pcie设备的结构示意图。如图4所示，该pcie设备包括：
66.获取模块401：用于获取pcie主机端的速度等级与pcie设备端的速度等级；
67.调整模块402：用于若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同；
68.通信模块403：用于根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。
69.在一个可行的实施例中，上述通信模块403还用于：
70.当pcie主机端的速度等级高于或者等于pcie设备端的速度等级，pcie设备端的速度等级通过pcie总线与pcie主机端进行数据通信。
71.在一个可行的实施例中，在根据pcie主机端的速度等级适配pcie设备端的速度等级的方面，调整模块402具体用于：
72.根据pcie主机端速度等级降低pcie设备端的速度等级，以使pcie设备端的速度等级与pcie主机端速度等级相同。
73.在一个可行的实施例中，在根据pcie主机端的速度等级适配pcie设备端的速度等级的方面，调整模块402还具体用于：
74.根据所述pcie主机端速度等级触发pcie总线物理链路re-train，以使pcie设备端与所述pcie主机端正常通信。
75.在一个可行的实施例中，在根据pcie主机端速度等级触发pcie总线物理链路re-train的方面，调整模块402具体用于：
76.调训pcie总线物理链路的速度等级；
77.调训pcie总线物理链路的链路带宽；
78.调训pcie总线物理链路的信号质量值。
79.在一个可行的实施例中，上述通信模块403还用于根据pcie主机端的速度等级，匹配对应速度等级的阻抗匹配参数、信号衰减补偿参数；选择阻抗匹配、信号衰减补偿的参数对应的通信线路后通过pcie总线与pcie主机端进行数据通信。
80.在一个可行的实施例中，上述调整模块402还用于：
81.对pcie设备端进行硬件初始化，配置时钟信号，配置ddr类型。
82.需要说明的是，上述各模块(获取模块401、调整模块402和通信模块403)用于执行上述方法的相关步骤。比如获取模块401用于执行步骤s201的相关内容，调整模块402用于执行步骤s202的相关内容；通信模块403用于执行步骤s203的相关内容。
83.在本实施例中，pcie设备400是以模块的形式来呈现。这里的“模块”可以指特定应用集成电路(application-specific integrated circuit，asic)，执行一个或多个软件或固件程序的处理器和存储器，集成逻辑电路，和/或其他可以提供上述功能的器件。此外，以上获取模块401、调整模块402和通信模块403可通过图5所示的pcie设备的处理器501和通信接口503来实现。
84.如图5所示pcie设备500可以图5中的结构来实现，该pcie设备500包括至少一个处理器501，至少一个存储器502、及至少一个通信接口503。所述处理器501、所述存储器502、和所述通信接口503通过所述通信总线连接并完成相互间的通信。
85.处理器501可以是通用中央处理器(cpu)，微处理器，特定应用集成电路(application-specific integrated circuit，asic)，或一个或多个用于控制以上方案程序执行的集成电路。
86.通信接口503，用于与其他设备或通信网络通信，如以太网，无线接入网(ran)，无线局域网(wireless local area networks，wlan)等。
87.存储器502可以是只读存储器(read-only memory，rom)或可存储静态信息和指令的其他类型的静态存储设备，随机存取存储器(random access memory，ram)或者可存储信息和指令的其他类型的动态存储设备，也可以是电可擦可编程只读存储器(electrically erasable programmable read-only memory，eeprom)、只读光盘(compact disc read-only memory，cd-rom)或其他光盘存储、光碟存储(包括压缩光碟、激光碟、光碟、数字通用光碟、蓝光光碟等)、磁盘存储介质或者其他磁存储设备、或者能够用于携带或存储具有指令或数据结构形式的期望的程序代码并能够由计算机存取的任何其他介质，但不限于此。存储器602可以是独立存在，通过总线与处理器501相连接。存储器502也可以和处理器501集成在一起。
88.其中，所述存储器502用于存储执行以上方案的应用程序代码，并由处理器501来控制执行。所述处理器501用于执行所述存储器502中存储的应用程序代码。
89.存储器502存储的代码可执行以上提供的一种多速率适配方法，比如：
90.获取pcie主机端的速度等级与pcie设备端的速度等级；若pcie主机端的速度等级低于pcie设备端的速度等级，则调整pcie设备端的速度等级，以使调整后的pcie设备端的速度等级与pcie主机端的速度等级相同；根据pcie主机端的速度等级与调整后的pcie设备端速度等级通过pcie总线与pcie主机端进行数据通信。
91.本技术实施例还提供一种计算机存储介质，其中，该计算机存储介质可存储有程序，该程序执行时包括上述方法实施例中记载的任何一种多速率适配方法的部分或全部步骤。
92.需要说明的是，对于前述的各方法实施例，为了简单描述，故将其都表述为一系列的动作组合，但是本领域技术人员应该知悉，本技术并不受所描述的动作顺序的限制，因为依据本技术，某些步骤可以采用其他顺序或者同时进行。其次，本领域技术人员也应该知悉，说明书中所描述的实施例均属于优选实施例，所涉及的动作和模块并不一定是本技术所必须的。
93.在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
94.在本技术所提供的几个实施例中，应该理解到，所揭露的装置，可通过其它的方式实现。例如，以上所描述的装置实施例仅仅是示意性的，例如所述单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多个单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另一点，所显示或讨论的相互之间的耦合或直接耦合或通信连接可以是通过一些接口，装置或单元的间接耦合或通信连接，可以是电性或其它的形式。
95.所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本实施例方案的目的。
96.另外，在本技术各个实施例中的各功能单元可以集成在一个处理单元中，也可以是各个单元单独物理存在，也可以两个或两个以上单元集成在一个单元中。上述集成的单元既可以采用硬件的形式实现，也可以采用软件功能单元的形式实现。
97.所述集成的单元如果以软件功能单元的形式实现并作为独立的产品销售或使用时，可以存储在一个计算机可读取存储器中。基于这样的理解，本技术的技术方案本质上或者说对现有技术做出贡献的部分或者该技术方案的全部或部分可以以软件产品的形式体现出来，该计算机软件产品存储在一个存储器中，包括若干指令用以使得一台计算机设备(可为个人计算机、服务器或者网络设备等)执行本技术各个实施例所述方法的全部或部分步骤。而前述的存储器包括：u盘、只读存储器(rom，read-only memory)、随机存取存储器(ram，random access memory)、移动硬盘、磁碟或者光盘等各种可以存储程序代码的介质。
98.本领域普通技术人员可以理解上述实施例的各种方法中的全部或部分步骤是可以通过程序来指令相关的硬件来完成，该程序可以存储于一计算机可读存储器中，存储器可以包括：闪存盘、只读存储器(英文：read-only memory，简称：rom)、随机存取器(英文：random access memory，简称：ram)、磁盘或光盘等。
99.以上所述，以上实施例仅用以说明本技术的技术方案，而非对其限制；尽管参照前述实施例对本技术进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本技术各实施例技术方案的范围。
技术特征：1.一种多速率适配方法，应用于pcie设备端，其特征在于，包括：获取pcie主机端的速度等级与所述pcie设备端的速度等级；若所述pcie主机端的速度等级低于所述pcie设备端的速度等级，则调整所述pcie设备端的速度等级，以使调整后的所述pcie设备端的速度等级与所述pcie主机端的速度等级相同；根据所述pcie主机端的速度等级与调整后的所述pcie设备端速度等级通过pcie总线与所述pcie主机端进行数据通信。2.根据权利要求1所述的方法，其特征在于，所述方法还包括：若所述pcie主机端的速度等级高于或者等于所述pcie设备端的速度等级，则根据所述pcie设备端的速度等级通过所述pcie总线与所述pcie主机端进行数据通信。3.根据权利要求1或2所述的方法，其特征在于，所述根据所述pcie主机端的速度等级适配pcie设备端的速度等级，包括：根据所述pcie主机端速度等级降低所述pcie设备端的速度等级，以使所述pcie设备端的速度等级与所述pcie主机端速度等级相同。4.根据权利要求4所述的方法，其特征在于，所述根据所述pcie主机端速度等级适配所述pcie设备端的速度等级，还包括：根据所述pcie主机端速度等级触发pcie总线物理链路re-train，以使所述pcie设备端与所述pcie主机端正常通信。5.根据权利要求5所述的方法，其特征在于，所述根据所述pcie主机端速度等级触发pcie总线物理链路re-train，包括：调训所述pcie总线物理链路的速度等级；调训所述pcie总线物理链路的链路带宽；调训所述pcie总线物理链路的信号质量值。6.根据权利要求1所述的方法，其特征在于，所述根据所述pcie主机端的速度等级与调整后的所述pcie设备端速度等级通过所述pcie总线与所述pcie主机端进行数据通信，包括：根据所述pcie主机端的速度等级，匹配对应速度等级的阻抗匹配参数、信号衰减补偿参数；选择与所述阻抗匹配、信号衰减补偿的参数对应的通信线路后通过所述pcie总线与所述pcie主机端进行数据通信。7.根据权利要求1-6所述的方法，其特征在于，所述获取pcie主机端的速度等级与所述pcie设备端的速度等级之前，所述方法还包括：所述pcie设备端进行硬件初始化，配置时钟信号，配置ddr类型。8.一种pcie设备，其特征在于，包括：获取模块：用于获取pcie主机端的速度等级与所述pcie设备端的速度等级；调整模块：用于若所述pcie主机端的速度等级低于所述pcie设备端的速度等级，则调整所述pcie设备端的速度等级，以使调整后的所述pcie设备端的速度等级与所述pcie主机端的速度等级相同；通信模块：用于根据所述pcie主机端的速度等级与调整后的所述pcie设备端速度等级
通过pcie总线与所述pcie主机端进行数据通信。9.一种计算机设备，包括存储器和处理器，所述存储器存储有计算机程序，其特征在于，所述处理器执行所述计算机程序时实现权利要求1-7任一项所述的方法的步骤。10.一种计算机可读存储介质，其上存储有计算机程序，其特征在于，所述计算机程序被计算机设备执行时实现权利要求1-7任一项所述的方法的步骤。
技术总结本发明实施例公开了一种多速率适配方法及PCIe设备。方法包括：获取PCIe主机端的速度等级与PCIe设备端的速度等级；若PCIe主机端的速度等级低于PCIe设备端的速度等级，则调整PCIe设备端的速度等级，以使调整后的PCIe设备端的速度等级与PCIe主机端的速度等级相同；根据PCIe主机端的速度等级与调整后的PCIe设备端速度等级通过PCIe总线与PCIe主机端进行数据通信。解决了PCIe主机端的速度等级与PCIe设备端的速度等级不匹配无法正常通信和PCIe分析仪无法抓取速度等级高于自身许可的速度等级的PCIe总线数据的问题，节省了更换PCIe分析仪设备的成本。仪设备的成本。仪设备的成本。
技术研发人员：王辉
受保护的技术使用者：深圳市广和通无线股份有限公司
技术研发日：2022.03.29
技术公布日：2022/7/5
